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由图知，主存物理空间占 20+3+5=28 位
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TLB 采用全相联映射，用 SRAM（静态RAM）实现
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Cache 采用二路组相联；Cache 每行中除数据(Data)、Tag和有效位外，还应有替换算法位、脏位这两种附加位；块内地址5位，说明块大小为 25=32B，组号 3 位说明有 23=8 组，总容量为 组行8组×2行×(32B×8b/B+20b+1b+1b+log22b)；Cache有效位说明 Cache 内数据是否有效
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CPU 给出的虚拟地址为 0008 C040H，其中虚页号为
0008 C，由图得知命中 Cache，再拿 Cache 内的 Tag 位与虚拟地址低12位（偏移量）拼接，得到对应的物理地址0040 0040H；虚拟地址为 0007 C260H，其中偏移量为260H，根据 Cache 结构拆开偏移量——0010 0110 0000，那么块内地址为0 0000，组号为011，这就得到了 Cache 组号为3
评分及理由
（1）得分及理由（满分2分）
学生正确计算出主存物理地址为28位，与标准答案一致。得2分。
（2）得分及理由（满分4分）
学生正确指出TLB采用全相联映射，并用SRAM实现，与标准答案一致。得4分。
（3）得分及理由（满分4分）
第一问正确指出Cache采用二路组相联映射（即2路组相联）。第二问正确指出需要替换算法位和脏位（即一致性维护位）。第三问计算Cache总容量时，虽然思路正确（考虑了数据、Tag、有效位、替换位和脏位），但具体计算表达式不够清晰且未给出最终数值结果，且标准答案中给出了具体的558字节，此处表述不完整。第四问正确说明了有效位的作用。综合考虑，第三问的计算部分有缺陷，扣1分。得3分。
（4）得分及理由（满分5分）
第一问正确得出物理地址00400040H（学生写作0040 0040H，含义相同）。第二问判断是否在Cache命中时，学生说"命中"，但根据标准答案分析应为不命中（因为Tag为00400H的项有效位为0或不存在），此处存在逻辑错误。第三问正确计算出Cache组号为3。第二问错误扣2分。得3分。
题目总分：2+4+3+3=12分
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